Cologne Chip AG

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50668 Köln

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Deutschland

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Cologne Chip^TM AG ist ein Halbleiterhersteller, der neben Telekommunikations-ICs und Intellectual Property (IP) seit diesem Jahr FPGAs anbietet. Mit der GateMate^TM FPGA Familie adressiert das Unternehmen alle Anforderungen, die typische Anwendungen an kleine bis mittelgroße FPGAs stellen. Das programmierbare Silizium ist in Low-power- und Speed-Anwendungen und damit in einer Vielzahl von Bereichen einsetzbar: Industrie, Automatisierung , Kommunikation, Sicherheit, Automotive, IoT, Lighting etc.
Die Logikkapazität, der Stromverbrauch, die Gehäusegröße und die PCB-Kompatibilität von GateMate^TM sind für einen großen Bereich von Applikationen optimiert. Die FPGAs kombinieren diese Funktionen mit den niedrigsten spezifischen Kosten am Markt, sodass die Geräte von Universitätsprojekten bis hin zu Großserienanwendungen ideal einsetzbar sind. Aufgrund des optimalen Verhältnisses von Schaltkreisgröße zu Kosten können auch preissensitive Anwendungen die Vorteile der FPGAs nutzen.
Da die Cologne Chip^TM AG auf eine Firmengeschichte von über 25 Jahren zurückblicken kann, profitieren ihre Kunden bei GateMate^TM FPGAs von ausgezeichneter Branchenkenntnis, einem erfahrenen Team sowie von einem Design- und Fertigungsstandort „Made in Germany“.. GateMate^TM FPGAs werden durch das Bundesministerium für Wirtschaft und Energie gefördert.

GateMate FPGA

Übersicht zu GateMate^TM FPGA
Die GateMate^TM FPGA-Familie der Cologne Chip^TM AG basiert auf einer neuartigen FPGA-Architektur, die ein spezielles Logikelement namens Cologne Programmable Element (CPE) mit einer intelligenten Routing-Engine kombiniert. Darüber hinaus sind Multiplizierer beliebiger Größe realisierbar. Speicherbasierte Anwendungen können Block-RAMs mit Bitbreiten von 1 bis 80 Bit verwenden. Auch bitweises Enable ist möglich.
General Purpose IOs (GPIOs) können unterschiedliche Spannungspegel von 1,2 bis 2,5 Volt benutzen. GPIOs können als Single-Ended oder LVDS konfiguriert werden. Weiterhin steht eine schnelle SERDES-Schnittstelle zur Verfügung.

GateMate^TM FPGAs werden von der Software EasyConvert^TM unterstützt, sodass vorhandene FPGA-Designs ohne neue Synthese einfach von exisitierenden Designs übernommen werden können. Die P&R-Software konvertiert das Design und implementiert es für GateMate^TM FPGAs. Eine Static Timing Analysis (STA) wird ebenfalls immer durchgeführt und gibt Aufschluss über kritische Pfade und die Leistungsbewertung der Implementation. Das Design kann mithilfe von Verilog-Netzlisten und SDF-Timing-Extraktion einfach simuliert werden.
GateMate FPGAs werden im Globalfoundries^TM 28 nm SLP-Verfahren (Super Low Power) hergestellt. Aufgrund der in Europa ansässigen Produktion besteht keine Gefahr von Handelsbeschränkungen oder hohen Zöllen.

Technische Merkmale von GateMate^TM FPGA

Logikkapazität von 40.000 auf mehr als eine Million LUT 4-Äquivalente
Neuartige Architektur mit innovativem programmierbaren Element (CPE)
CPE besteht aus LUT-tree mit 8 Eingängen
3 Betriebsbereiche: low-power, economy, speed
FPGA im Ball Grid-Gehäuse für geringe Größe und hohe Pinanzahl
Nur 2 Signallagen auf der Leiterplatte erforderlich
Niedrige Anzahl von Konfigurationsbits
Sehr schnelle Konfiguration mit 4-Bit-SPI-Schnittstelle bis 100 MHz
Keine überhöhten Anlaufströme
Es werden nur zwei Versorgungsspannungen benötigt, die in beliebiger Reihenfolge angelegt werden können
Mehrere Taktschemata
Dual-Port-Block-RAMs mit 20-80 Bit Datenbreite, auch als FIFO konfigurierbar
Multiplizierer mit beliebiger Bitbreite der Faktoren implementierbar
SERDES 2,5 Gbit/s
General Purpose IOs (GPIOs), konfigurierbar als Single-Ended oder LVDS
Pullup-/Pulldown-Widerstände konfigurierbar
Unterstützung für ADC und DAC mit zusätzlichen IP-Cores
Core-Spannung je nach Anwendungsmodus: 0,9 V, 1,0 V, 1,1 V
28 nm SLP Globalfoundries^TM-Prozesstechnologie mit geringer Leistungsaufnahme und hoher Performance
Hergestellt in Europa
EasyConvert^TM-Software zum Migrieren vorhandener Designs zu GateMate^TM
GateMate^TM Place & Route mit automatischer Clock-Skew-Optimierung
Statische Timing Analyse zur Leistungsbewertung

GateMate^TM FPGA ist in verschiedenen Größen erhältlich:

CCGM1A1: 20.480 CPEs | 20.480 8-Inp-LUTtree | 40.960 FF/Latches | 4 PLLs | 1 SERDES | 320 BGA Balls | 15x15 mm
CCGM1A2: 40.960 CPEs | 40.960 8-Inp-LUTtree | 81.920 FF/Latches | 8 PLLs | 2 SERDES | 320 BGA Balls | 15x15 mm
CCGM1A4: 81.920 CPEs | 81.920 8-Inp-LUTtree | 163.840 FF/Latches | 16 PLLs | 4 SERDES | 320 BGA Balls | 15x15 m
CCGM1A9: 184.320 CPEs | 184.320 8-Inp-LUTtree | 368.640 FF/Latches | 36 PLLs | 9 SERDES
CCGM1A16: 327.680 CPEs | 327.680 8-Inp-LUTtree | 655.360 FF/Latches | 64 PLLs | 16 SERDES
CCGM1A25: 512.000 CPEs | 512.000 8-Inp-LUTtree | 1.024.000 FF/Latches | 100 PLLs | 25 SERDES