27. Februar - 1. März 2018 // Nürnberg, Germany

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64 kb SPI nvSRAM ANV32E61W

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The Anvo-Systems Dresden ANV32E61W is a 64kb serial SRAM with a non-volatile SONOS storage element included with each memory cell, organized as 8k words of 8 bits each. The devices are accessed by a high speed SPI-compatible bus. The ANV32E61W is enabled through the Chip Enable pin (E) and accessed via a 3-wire interface consisting of Serial Data Input (SI), Serial Data Output (SO) and Serial Clock (SCK). All programming cycles are self-timed, and no separate ERASE cycle is required before STORE.

The serial SRAM provides the fast access & cycle times, ease of use and unlimited read & write endurance of a normal SRAM. Dedicated safety features supporting high data accuracy.

With Secure WRITE operation the ANV32E61W accepts address and data only when the correct 2-Byte CRC, generated from the 13 bit address and 64 Byte data, is transmitted. Corrupt data cannot overwrite existing memory content and even valid data would not overwrite on a corrupted address. With status register bit 4 the success of the WRITE operation can be monitored. In case of corrupt data bit 4 will be set volatile to high. With Secure READ operation the ANV32E61W calculates the correct 2-Byte CRC parallel to data transfer. The 2Byte CRC is transmitted after 64 Bytes of data have been transmitted.

Data transfers automatically to the non-volatile storage cells when power loss is detected or in any brown out situation (the PowerStore operation). On power up, data is automatically restored to the SRAM (the Power Up Recall operation).

With Read Last Successful Written Address it is possible, after Power Up Recall, to read out the address where data were last written successfully, before a PowerStore.

Both STORE and RECALL operations are also available under instruction control.

BLOCK WRITE Protection is enabled by programming the status register with one of four options to protect blocks.

A 2-Byte non-volatile register supports the option of a 2-Byte user defined serial number. This register is under customer control only.

Status register bit 5 will control page and block roll over modes.

1 Mb parallel nvSRAM ANV22AA8WB

LOGO_1 Mb parallel nvSRAM ANV22AA8WB

1 Mb Quad SPI nvSRAM ANV32AA3PB

LOGO_1 Mb Quad SPI nvSRAM ANV32AA3PB

1 Mb SPI nvSRAM ANV32AA1WD

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64 kb I²C nvSRAM ANV32A62W

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64 kb SPI nvSRAM ANV32E61W ist folgenden Produktgruppen zugeordnet:

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